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군용Single Board Computer에서의 고속메모리모듈I/F구현
| DC Field | Value | Language |
|---|---|---|
| dc.contributor.advisor | 김영길 | - |
| dc.contributor.author | 이특수 | - |
| dc.date.accessioned | 2018-10-16T02:18:50Z | - |
| dc.date.available | 2018-10-16T02:18:50Z | - |
| dc.date.issued | 2010-08 | - |
| dc.identifier.other | 10963 | - |
| dc.identifier.uri | https://dspace.ajou.ac.kr/handle/2018.oak/2098 | - |
| dc.description | 학위논문(석사)--아주대학교 일반대학원 :전자공학과,2010. 8 | - |
| dc.description.tableofcontents | 제1장 서 론 1 제2장 본 론 3 제2.1절 고속 접속(Interface) 3 제2.1.1항 드라이버 방식 3 제2.1.2항 SSTL-2(Stub Series Terminated Logic for 2.5V) 5 제2.2절 DDR SDRAM 12 제2.2.1항 DDR SDRAM 개념 12 제2.2.2항 DDR SDRAM 중요 AC SPEC 13 제2.3절 System Controller(MV64460, Marvell) 14 제2.3.1항 System Controller와의 관계 14 제2.3.2항 MV64460의 사양 14 제2.3.3항 MV64460의 기능 및 특징 15 제2.3.4항 Memory Controller로서의 구현 16 제2.3.5항 타이밍 파라미터 17 제2.3.6항 M_STARTBURST 신호 19 제2.3.7항 M_DCAL, M_ACAL 20 제2.3.8항 DFCDL 20 제2.4절 제약조건 21 제2.4.1항 군용SBC의 제약 조건의 정의 21 제2.4.2항 기구적 조건. 21 제2.4.3항 기능의 다양화 및 복잡성. 24 제2.4.4항 군용 운용환경요구 25 제2.5절 구현 26 제2.5.1항 PCB 적층 구조 26 제2.5.2항 PCB 패턴 라우팅분석 28 제2.5.3항 부품 배치 30 제2.5.4항 구현 SBC 형상 31 제2.6절 시뮬레이션과정 및 결과 34 제2.6.1항 어드레스 신호 34 제2.6.2항 클럭 신호 36 제2.6.3항 데이터 신호 38 제2.6.4항 DQS 신호 40 제3장 결론 및 고찰 42 참고문헌 44 ABSTRACT 45 | - |
| dc.language.iso | kor | - |
| dc.publisher | The Graduate School, Ajou University | - |
| dc.rights | 아주대학교 논문은 저작권에 의해 보호받습니다. | - |
| dc.title | 군용Single Board Computer에서의 고속메모리모듈I/F구현 | - |
| dc.type | Thesis | - |
| dc.contributor.affiliation | 아주대학교 일반대학원 | - |
| dc.contributor.department | 일반대학원 전자공학과 | - |
| dc.date.awarded | 2010. 8 | - |
| dc.description.degree | Master | - |
| dc.identifier.localId | 568851 | - |
| dc.identifier.url | http://dcoll.ajou.ac.kr:9080/dcollection/jsp/common/DcLoOrgPer.jsp?sItemId=000000010963 | - |
- Appears in Collections:
- Graduate School of Ajou University > Department of Electronic Engineering > 3. Theses(Master)
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