스퓨리어스 톤 억제를 위한 rotational DCDL과 PRNG를 이용한 DLL 기반의 클락 발생기

DC Field Value Language
dc.contributor.advisor지동우-
dc.contributor.author노진섭-
dc.date.accessioned2019-04-01T16:40:21Z-
dc.date.available2019-04-01T16:40:21Z-
dc.date.issued2019-02-
dc.identifier.other28525-
dc.identifier.urihttps://dspace.ajou.ac.kr/handle/2018.oak/14855-
dc.description학위논문(석사)--아주대학교 일반대학원 :전자공학과,2019. 2-
dc.description.abstract본 논문은 스퓨리어스 톤(Spurious Tone) 감소를 위해 의사 난수 생성기(Pseudo Random Number Generator, PRNG)와 회전형 디지털 제어 지연 단(Rotational Digitally Controlled Delay Line, Rotational-DCDL)을 사용한 지연 고정 루프(Delay Locked Loop, DLL) 기반의 클럭 발생기를 소개한다. 의사 난수 생성기에 의해 무작위로 지연 단을 선택함으로써, 지연 셀의 미스매치에 의해 출력에 나타나는 스퓨리어스 톤을 낮추는 방법을 제안한다. 무작위로 선택되는 지연 단에서 지속적으로 체배된 출력을 얻기 위해, 고리형태의 새로운 Rotational-DCDL을 새롭게 제안한다. 제안하는 DLL 기반의 클락 발생기는 16 MHz를 생성하며, 약 5 ~ 11 dB의 스퓨리어스 톤 감소를 성공적으로 달성했다. 표준 0.18μm CMOS 공정으로 설계된 클락 발생기는 16 MHz에서 169.4μW 를 소비하며, 칩 면적은 0.608 mm2 입니다. 주제어– 지연 고정 루프, 클락 발생기, 스퓨리어스 톤, 의사 난수 발생기-
dc.description.tableofcontentsI 서론 1 II 본론 7 A. 설계 7 1. 회전형 디지털 제어 지연 단과 매트릭스 스위치 10 1) 구성과 원리 10 2) 동작 15 2. 의사 난수 생성기와 복호기 17 3. 디지털 루프필터와 전류 조절 아날로그-디지털 변환기 20 B. 시뮬레이션 결과 25 1. 매틀랩 시뮬레이션 검증 25 2. 시뮬레이션 환경 구성 25 3. 포스트-레이아웃 시뮬레이션 검증 30 1) 지터 특성 30 2) 스퓨리어스 톤 33 4. 성능 비교 36 III 결론 38 참고문헌 39 Abstract 41-
dc.language.isokor-
dc.publisherThe Graduate School, Ajou University-
dc.rights아주대학교 논문은 저작권에 의해 보호받습니다.-
dc.title스퓨리어스 톤 억제를 위한 rotational DCDL과 PRNG를 이용한 DLL 기반의 클락 발생기-
dc.title.alternativeNoh, Jin Seop-
dc.typeThesis-
dc.contributor.affiliation아주대학교 일반대학원-
dc.contributor.alternativeNameNoh, Jin Seop-
dc.contributor.department일반대학원 전자공학과-
dc.date.awarded2019. 2-
dc.description.degreeMaster-
dc.identifier.localId905468-
dc.identifier.uciI804:41038-000000028525-
dc.identifier.urlhttp://dcoll.ajou.ac.kr:9080/dcollection/common/orgView/000000028525-
Appears in Collections:
Graduate School of Ajou University > Department of Electronic Engineering > 3. Theses(Master)
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